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基于DSP和CPLD的高精度頻率測(cè)量系統(tǒng)設(shè)計(jì)
介紹了以CPLD(Complex Programmable Logic Device)為核心處理芯片的頻率測(cè)量系統(tǒng),整個(gè)系統(tǒng)由信號(hào)調(diào)理電路、CPLD和DSP等構(gòu)成,在CPLD中設(shè)計(jì)等精度測(cè)頻模塊,再由DSP進(jìn)行數(shù)字濾波并將采集值送至雙口RAM以供上位機(jī)讀取.采用CPLD 配合DSP的設(shè)計(jì)方案,具有速度高、精度高的優(yōu)點(diǎn),且易于升級(jí)和擴(kuò)展采集能力,具有一定的工程應(yīng)用價(jià)值.
作 者： 席鵬 李軍 於二軍 XI Peng LI Jun YU Er-jun 作者單位： 中國(guó)航空計(jì)算技術(shù)研究所,陜西,西安,710068 刊 名： 航空計(jì)算技術(shù) ISTIC 英文刊名： AERONAUTICAL COMPUTING TECHNIQUE 年，卷(期)： 2010 40(2) 分類號(hào)： V2 關(guān)鍵詞： 頻率測(cè)量 CPLD DSP【基于DSP和CPLD的高精度頻率測(cè)量系統(tǒng)設(shè)計(jì)】相關(guān)文章：
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