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導(dǎo)航接收機(jī)的非對(duì)稱異步FIFO設(shè)計(jì)

時(shí)間:2023-04-28 14:49:52 航空航天論文 我要投稿
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導(dǎo)航接收機(jī)的非對(duì)稱異步FIFO設(shè)計(jì)

無(wú)線電導(dǎo)航系統(tǒng)接收機(jī)中采用了多個(gè)通道對(duì)各個(gè)基站發(fā)來(lái)的數(shù)據(jù)進(jìn)行并行處理,在FPGA和DSP中需要相互交換各種不同寬度和傳輸速率的數(shù)據(jù),文中在重點(diǎn)分析了FPGA中設(shè)計(jì)的非對(duì)稱異步FIFO結(jié)構(gòu)特點(diǎn)及設(shè)計(jì)難點(diǎn)的基礎(chǔ)上,提出具有總線功能的異步FIFO,即寫入字寬和讀出字寬不同的高速異步FIFO設(shè)計(jì).采用VHDL語(yǔ)言描述,增加了硬件設(shè)計(jì)的可移植性和通用性,給導(dǎo)航接收機(jī)提供了一種簡(jiǎn)單有效的數(shù)據(jù)傳輸解決方案.

作 者: 黃平 何虎剛 徐定杰 HUANG Ping HE Hugang XU Dingjie   作者單位: 哈爾濱工程大學(xué)自動(dòng)化學(xué)院,哈爾濱,150001  刊 名: 彈箭與制導(dǎo)學(xué)報(bào)  PKU 英文刊名: JOURNAL OF PROJECTILES, ROCKETS, MISSILES AND GUIDANCE  年,卷(期): 2008 28(1)  分類號(hào): V241.62 TN911.72  關(guān)鍵詞: 異步FIFO   VHDL   亞穩(wěn)態(tài)   Gray碼   非對(duì)稱   FPGA  

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